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标题: 数字信号处理FPGA的功耗 [打印本页]

作者: liyf 时间: 2012-1-27 14:09
标题: 数字信号处理FPGA的功耗

　　FPGA的功耗可以说是一个关键的设计约束条件，特别是对于移动应用。因此在本例中推荐使用3.3V或更低电压级别的元器件。为了估算Altera元器件EPF10K70RC240 - 4的功耗，必须考虑3个方面的囚素，也就是：
　　（1）维持功耗：Istandby≈0.5mA
　　（2）I/O功耗II/O
　　（3）有效功耗Iactive
　　前两项是与设计无关的，而且CMOS技术中产生的维持功耗非常少。有效电流主要与时钟频率和使用的LE数目有关。Altera提供了如下估算实际功耗的经验公式：
　　

　　其中fmax是按MHz计算的最大工作频率，N是元器件中使用的所有逻辑单元的总数，TLE是逻辑单元在每个时钟周期内触发的平均百分比（典型值是12％）。例如：假定设汁者使用了EPF10K70RC240－4的所有LE，且最大工作频率是25MHz，那么电流值就约为954mA。
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