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[电路图] 数字钟原理框图

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发表于 2011-6-4 12:10:09 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
数字钟原理框图



数字钟系统构成
1、数字钟的构成:振荡器、分频器、计数器、译码器、显示器等几部分
2、数字钟的时、分、秒实际上就是由一个24进制计数器(00-23),两个60进制计数器(00-59)级联构成。设计数字钟实际上就是计数器的级联。
3、60进制计数器的设计
4、24进制计数器的设计
5、计数器的级联设计
(二)、数字钟设计要点:EWB软件本身提供任意频率的时钟,因此振荡器、分频器不需设计;
另外EWB软件也带有内置译码驱动的数码管,故此译码器和显示器也不需设计。
这样,数字钟的设计实际上就是设计如下图的计数器
EWB软件本身提供任意频率的时钟,因此振荡器、分频器不需设计;
另外EWB软件也带有内置译码驱动的数码管,故此译码器和显示器也不需设计。
这样,数字钟的设计实际上就是设计如下图的计数器.



(三)、芯片选型 由于24进制、60进制计数器均由集成计数器级联构成,且都包含有基本的十进制计数器,从设计简便考虑,芯片选择同步十进制计数器74LS160。
(四)、计数器电路
计数器级联时的时钟构成方式可以采用同步时钟,也可以采用异步时钟,这里给出的参考图采用了异步时钟,详图见后页。
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